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摘要 PLL是Phase-Locked Loop的缩写，中文含意为锁相环。PLL基本上是一个闭环的反馈控制系统，它可以使PLL的输出可以与一个参考信号保持固定的相位关系。PLL一般由鉴相器、电荷放大器（Charge Pump）、低通滤波器、压控振荡器、以及某种形式的输出转换器组成。为了使得PLL的输出频率是参考时钟的倍数关系，在PLL的反馈路径或（和）参考信号路径上还可以放置分频器。
关键字：锁相环 高频率分频器 电荷放大器 频率检波器 目 录
1. ADF4007芯片简介..................................................................4--6 1.1 ADF4007D重要电气特性...........................................................4--6 1。2 ADF4007D的最大额定值...........................................................6--7 2. ADF4007芯片封装与引脚功能........................................................7-9 3. ADF4007内部结构与工作原理 ......................................................10--13 3.1基准信号输入电路.................................................................10 3.2 射频输入电路...................................................................10--11 3.3 前置分频器.....................................................................11 3.4 R计数器.......................................................................11 3.5 相位频率检波器和充电泵........................................................11--12 3.6 多路复用.....................................................................12--13 3.7 PFD极性.....................................................................13 3.8 充电泵输出..................................................................13
4。ADF4007应用电路设计.............................................................13--15 4。1高频装置的本地振荡器（LO.......................................................13--14 4。2 ADF4007的分频作用.............................................................14 4。3 PCB图指针与元器件比例间隙.....................................................15 4。4 外形.........................................................................15 5. 总结............................................................................15--16 6.参考文献.........................................................................16
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